board: freescale: ls1012afrdm: enable network support on ls1012afrdm
This patch enables ethernet support for ls1012afrdm. Signed-off-by: Calvin Johnson <calvin.johnson@nxp.com> Signed-off-by: Anjaneyulu Jagarlmudi <anji.jagarlmudi@nxp.com> Acked-by: Joe Hershberger <joe.hershberger@ni.com>
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a141f33af5
4 changed files with 154 additions and 5 deletions
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@ -12,6 +12,35 @@ config SYS_SOC
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config SYS_CONFIG_NAME
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default "ls1012afrdm"
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if FSL_PFE
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config BOARD_SPECIFIC_OPTIONS # dummy
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def_bool y
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select PHYLIB
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imply PHY_REALTEK
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config SYS_LS_PFE_FW_ADDR
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hex "Flash address of PFE firmware"
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default 0x40a00000
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config DDR_PFE_PHYS_BASEADDR
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hex "PFE DDR physical base address"
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default 0x03800000
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config DDR_PFE_BASEADDR
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hex "PFE DDR base address"
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default 0x83800000
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||||
config PFE_EMAC1_PHY_ADDR
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||||
hex "PFE DDR base address"
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default 0x2
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config PFE_EMAC2_PHY_ADDR
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||||
hex "PFE DDR base address"
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default 0x1
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||||
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||||
endif
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source "board/freescale/common/Kconfig"
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||||
endif
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||||
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@ -5,3 +5,4 @@
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#
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obj-y += ls1012afrdm.o
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||||
obj-$(CONFIG_FSL_PFE) += eth.o
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||||
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124
board/freescale/ls1012afrdm/eth.c
Normal file
124
board/freescale/ls1012afrdm/eth.c
Normal file
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@ -0,0 +1,124 @@
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|||
/*
|
||||
* Copyright 2015-2016 Freescale Semiconductor, Inc.
|
||||
* Copyright 2017 NXP
|
||||
*
|
||||
* SPDX-License-Identifier: GPL-2.0+
|
||||
*/
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||||
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||||
#include <common.h>
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||||
#include <dm.h>
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#include <asm/io.h>
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||||
#include <netdev.h>
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#include <fm_eth.h>
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||||
#include <fsl_mdio.h>
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||||
#include <malloc.h>
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#include <asm/types.h>
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||||
#include <fsl_dtsec.h>
|
||||
#include <asm/arch/soc.h>
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||||
#include <asm/arch-fsl-layerscape/config.h>
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||||
#include <asm/arch-fsl-layerscape/immap_lsch2.h>
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||||
#include <asm/arch/fsl_serdes.h>
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#include <net/pfe_eth/pfe_eth.h>
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#include <dm/platform_data/pfe_dm_eth.h>
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||||
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||||
#define DEFAULT_PFE_MDIO_NAME "PFE_MDIO"
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#define DEFAULT_PFE_MDIO1_NAME "PFE_MDIO1"
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||||
#define MASK_ETH_PHY_RST 0x00000100
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||||
static inline void ls1012afrdm_reset_phy(void)
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{
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unsigned int val;
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struct ccsr_gpio *pgpio = (void *)(GPIO1_BASE_ADDR);
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||||
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||||
setbits_be32(&pgpio->gpdir, MASK_ETH_PHY_RST);
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||||
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||||
val = in_be32(&pgpio->gpdat);
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||||
setbits_be32(&pgpio->gpdat, val & ~MASK_ETH_PHY_RST);
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||||
mdelay(10);
|
||||
|
||||
val = in_be32(&pgpio->gpdat);
|
||||
setbits_be32(&pgpio->gpdat, val | MASK_ETH_PHY_RST);
|
||||
mdelay(50);
|
||||
}
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||||
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||||
int pfe_eth_board_init(struct udevice *dev)
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||||
{
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static int init_done;
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||||
struct mii_dev *bus;
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||||
struct pfe_mdio_info mac_mdio_info;
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||||
struct pfe_eth_dev *priv = dev_get_priv(dev);
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||||
|
||||
if (!init_done) {
|
||||
ls1012afrdm_reset_phy();
|
||||
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||||
mac_mdio_info.reg_base = (void *)EMAC1_BASE_ADDR;
|
||||
mac_mdio_info.name = DEFAULT_PFE_MDIO_NAME;
|
||||
|
||||
bus = pfe_mdio_init(&mac_mdio_info);
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||||
if (!bus) {
|
||||
printf("Failed to register mdio\n");
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||||
return -1;
|
||||
}
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||||
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||||
init_done = 1;
|
||||
}
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||||
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||||
if (priv->gemac_port) {
|
||||
mac_mdio_info.reg_base = (void *)EMAC2_BASE_ADDR;
|
||||
mac_mdio_info.name = DEFAULT_PFE_MDIO1_NAME;
|
||||
bus = pfe_mdio_init(&mac_mdio_info);
|
||||
if (!bus) {
|
||||
printf("Failed to register mdio\n");
|
||||
return -1;
|
||||
}
|
||||
}
|
||||
|
||||
pfe_set_mdio(priv->gemac_port,
|
||||
miiphy_get_dev_by_name(DEFAULT_PFE_MDIO_NAME));
|
||||
if (!priv->gemac_port)
|
||||
/* MAC1 */
|
||||
pfe_set_phy_address_mode(priv->gemac_port,
|
||||
CONFIG_PFE_EMAC1_PHY_ADDR,
|
||||
PHY_INTERFACE_MODE_SGMII);
|
||||
else
|
||||
/* MAC2 */
|
||||
pfe_set_phy_address_mode(priv->gemac_port,
|
||||
CONFIG_PFE_EMAC2_PHY_ADDR,
|
||||
PHY_INTERFACE_MODE_SGMII);
|
||||
return 0;
|
||||
}
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||||
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||||
static struct pfe_eth_pdata pfe_pdata0 = {
|
||||
.pfe_eth_pdata_mac = {
|
||||
.iobase = (phys_addr_t)EMAC1_BASE_ADDR,
|
||||
.phy_interface = 0,
|
||||
},
|
||||
|
||||
.pfe_ddr_addr = {
|
||||
.ddr_pfe_baseaddr = (void *)CONFIG_DDR_PFE_BASEADDR,
|
||||
.ddr_pfe_phys_baseaddr = CONFIG_DDR_PFE_PHYS_BASEADDR,
|
||||
},
|
||||
};
|
||||
|
||||
static struct pfe_eth_pdata pfe_pdata1 = {
|
||||
.pfe_eth_pdata_mac = {
|
||||
.iobase = (phys_addr_t)EMAC2_BASE_ADDR,
|
||||
.phy_interface = 1,
|
||||
},
|
||||
|
||||
.pfe_ddr_addr = {
|
||||
.ddr_pfe_baseaddr = (void *)CONFIG_DDR_PFE_BASEADDR,
|
||||
.ddr_pfe_phys_baseaddr = CONFIG_DDR_PFE_PHYS_BASEADDR,
|
||||
},
|
||||
};
|
||||
|
||||
U_BOOT_DEVICE(ls1012a_pfe0) = {
|
||||
.name = "pfe_eth",
|
||||
.platdata = &pfe_pdata0,
|
||||
};
|
||||
|
||||
U_BOOT_DEVICE(ls1012a_pfe1) = {
|
||||
.name = "pfe_eth",
|
||||
.platdata = &pfe_pdata1,
|
||||
};
|
|
@ -57,11 +57,6 @@ int dram_init(void)
|
|||
return 0;
|
||||
}
|
||||
|
||||
int board_eth_init(bd_t *bis)
|
||||
{
|
||||
return pci_eth_init(bis);
|
||||
}
|
||||
|
||||
int board_early_init_f(void)
|
||||
{
|
||||
fsl_lsch2_early_init_f();
|
||||
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